PLL de 1.4 GHz con distribución de reloj Analog Devices®6950

El LTC6950 de Analog Devices es un núcleo del sintetizador de frecuencia de número entero de bajo ruido de fase con distribución de reloj. El LTC6950 proporciona las señales de reloj con ruido de fase bajo exigidas en sistemas de adquisición de datos de alta frecuencia y alta resolución.

El sintetizador de frecuencia contiene un núcleo de sincronización de fase (PLL) completo de bajo nivel de ruido con un divisor de referencia programable (R), un divisor de retroalimentación programable (N), un detector de frecuencia/fase (PFD) y una bomba de carga de bajo ruido (CP). La sección de distribución de reloj del LTC6950 ofrece hasta cinco salidas basadas en la entrada VCO. Cada salida se programa individualmente para dividir la frecuencia de entrada de VCO por cualquier número entero de 1 a 63 y para retrasar la salida de 0 a 63 ciclos de reloj de VCO. Cuatro de las salidas cuentan con señales lógicas LVPECL de muy bajo ruido y baja desviación que pueden funcionar a hasta 1.4 GHz. La quinta salida se puede seleccionar como tipo lógico LVDS (800 MHz) o CMOS (250 MHz). Esta salida también está programada para producir una señal de salida basada en la entrada VCO o la salida del divisor de referencia.

Sincronización EZSync en los divisores de reloj del LTC6950

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Código LTC6950

Características

• Fluctuación aditiva: 18 fs_RMS (12 kHz a 20 MHz)
• Sincronización de borde de reloj multichip EZSync
• Núcleo PLL completo con indicador de bloqueo
• Piso de ruido de fase normalizado en banda de -226 dBc/Hz
• Ruido de fase 1/f normalizado de -274 dBc/Hz
• Frecuencia de entrada máxima de VCO de 1.4 GHz
• Cuatro salidas LVPECL independientes de bajo ruido a 1.4 GHz
• Una salida configurable LVDS/CMOS
• Cinco divisores programables independientemente
• Cinco retardos de ciclo de reloj VCO programables independientemente
• Soporte para herramientas de simulación y diseño de software ClockWizard

La GUI de ClockWizard agiliza el proceso de diseño y simulación

• Encuentre los parámetros PLL rápidamente
• Mostrar estabilidad y respuesta de frecuencia PLL
• Simule el ruido y la fluctuación de fase de salida
• Simule las relaciones de fase del reloj de salida según la configuración de EZSync
• Leer y escribir todos los registros de dispositivos
• Configurar usando una interfaz de programación de diagrama de bloques
• Solucionar problemas de configuración comunes
• Importar y exportar datos de ruido de salida, referencia y VCO